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专利状态

触发单元的设计方法

有效

专利申请进度

申请

2022-01-28

申请公布

2022-04-29

授权

2022-12-20

预估到期

2042-01-28

专利基础信息

申请号	CN202210107336.2	申请日	2022-01-28
申请公布号	CN114417759A	申请公布日	2022-04-29
授权公布号	CN114417759B	授权公告日	2022-12-20
分类号	G06F30/33;H03K3/037
分类	计算；推算；计数;
申请人名称	杭州士兰微电子股份有限公司
申请人地址	浙江省杭州市黄姑山路4号

专利法律状态

2022-12-20

授权

状态信息

授权
2022-04-29

公布

状态信息

公布

摘要

本申请公开了触发单元的设计方法。该设计方法包括：在数字电路中分析时钟控制信号的信号延迟；根据时钟控制信号的信号延迟，在多个不同类型的时钟门控电路中选择时钟门控电路；以及将至少一个边沿触发器和选择的时钟门控电路组合成触发单元，其中，多个不同类型的时钟门控电路根据时钟控制信号启用或屏蔽第一时钟信号以产生第二时钟信号，边沿触发器在第二时钟信号的边沿传输数据。该触发单元的设计方法根据时钟控制信号的延迟条件，从多个不同类型的时钟门控电路选择时钟门控电路，不仅可以消除时钟门控电路产生的时钟信号的毛刺，而且可以减少时钟门控电路的逻辑元件数量和降低时钟门控电路的功耗，适用于任意数量边沿触发器的触发器组。

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