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专利状态
通过电子电路的分区进行的逻辑强化方法
有效
专利申请进度
申请
2013-11-29
申请公布
2015-09-23
授权
2018-01-09
预估到期
2033-11-29
专利基础信息
申请号
CN201380070416.4
申请日
2013-11-29
申请公布号
CN104937595A
申请公布日
2015-09-23
授权公布号
CN104937595B
授权公告日
2018-01-09
分类号
G06F17/50
分类
计算;推算;计数;
申请人名称
法国电力公司
申请人地址
法国巴黎
专利法律状态
2018-01-09
授权
状态信息
授权
2015-10-21
实质审查的生效
状态信息
实质审查的生效IPC(主分类):G06F 17/50申请日:20131129
2015-09-23
公布
状态信息
公布
摘要
本发明涉及一种通过电子电路的分区进行的逻辑强化方法,所述电路包括:奇数K个分支,K个分支被并联连接到相同的主输入端I上,并且每个分支包括相同的N个模块序列以及N‑1个联结两个连续模块的节点,K个分支共同形成N‑1个连续的分别由并联的K个节点分别组成的门;以及,主仲裁器,形成K个分支的输出信号的多数票决,其特征在于,方法包括针对门中每一个重复以下步骤:确定由介于主输入端和门之间的K个分支部分组成的门上游的子电路的信度;以及当所查看的子电路的信度小于信度设定点时,在门处插入至少一个仲裁器,至少一个仲裁器执行构成所查看的子电路的分支部分的输出信号的多数票决,并且将至少一个多数信号传递到由门下游的分支部分组成的补充子电路的各个输入端处。
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