一种选择门优化的AES加解密方法及装置

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专利状态

一种选择门优化的AES加解密方法及装置

有效

专利申请进度

申请

2012-07-10

申请公布

2012-11-14

授权

2015-05-27

预估到期

2032-07-10

专利基础信息

申请号	CN201210236938.4	申请日	2012-07-10
申请公布号	CN102780557A	申请公布日	2012-11-14
授权公布号	CN102780557B	授权公告日	2015-05-27
分类号	H04L9/06
分类	电通信技术;
申请人名称	记忆科技（深圳）有限公司
申请人地址	广东省深圳市南山区蛇口后海大道东角头东南工贸大厦5楼

专利法律状态

2015-05-27

授权

状态信息

授权
2013-01-02

实质审查的生效

状态信息

实质审查的生效IPC(主分类):H04L 9/06申请日:20120710
2012-11-14

公布

状态信息

公开

摘要

本发明提供了一种选择门优化的AES加解密方法及装置，该方法包括：控制选择将轮运算结果或者待加/解密数据输出至寄存器；对寄存器中的数据进行Nr轮加/解密轮运算，Nr由密钥长度确定；通过加/解密控制信号控制选择输出加密轮运算结果或者解密轮运算结果至寄存器。借此，本发明能够降低芯片面积及功耗，同时减少关键路径上选择门的使用，缩短了关键路径，提高了AES模块的运行速度。

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