一种FPGA片间高位宽数据传输的方法及装置

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专利状态

一种FPGA片间高位宽数据传输的方法及装置

有效

专利申请进度

申请

2017-08-22

申请公布

2019-03-05

授权

2021-10-01

预估到期

2037-08-22

专利基础信息

申请号	CN201710725378.1	申请日	2017-08-22
申请公布号	CN109426636A	申请公布日	2019-03-05
授权公布号	CN109426636B	授权公告日	2021-10-01
分类号	G06F13/40
分类	计算；推算；计数;
申请人名称	深圳市中兴微电子技术有限公司
申请人地址	广东省深圳市南山区西丽街道留仙大道中兴工业园

专利法律状态

2021-10-01

授权

状态信息

授权
2019-03-29

实质审查的生效

状态信息

实质审查的生效；IPC(主分类):G06F13/40；申请日:20170822
2019-03-05

公布

状态信息

公布

摘要

本文公布了一种FPGA片间高位宽数据传输的方法及装置，包括：将第一片FPGA中待发送的并行数据与控制码字打包组成数据子帧并写入TX_RAM阵列中，所述TX_RAM阵列中的TX_RAM行数与当前SERDES的线速率、PCS接口数据位宽相匹配；将所述TX_RAM阵列中的数据子帧以列为单位按照TDM方式分时按行顺序输出；通过BIP处理将所述按行顺序输出的数据中控制码字更换为上一子帧的BIP校验码字；将所述BIP处理后的数据送入SERDES，以便SERDES并串转换之后送到第二片FPGA。本申请至少能够通过同一组帧装置适用多种SERDES线速率。

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