一种读取数据的电路、非易失存储器以及读取数据的方法

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专利状态

一种读取数据的电路、非易失存储器以及读取数据的方法

有效

专利申请进度

申请

2019-01-29

申请公布

2020-08-04

授权

2023-04-07

预估到期

2039-01-29

专利基础信息

申请号	CN201910087625.9	申请日	2019-01-29
申请公布号	CN111489773A	申请公布日	2020-08-04
授权公布号	CN111489773B	授权公告日	2023-04-07
分类号	G11C7/00
分类	信息存储;
申请人名称	兆易创新科技集团股份有限公司
申请人地址	安徽省合肥市经济技术开发区清华路368号

专利法律状态

2023-04-07

授权

状态信息

授权
2022-09-16

著录事项变更

状态信息

著录事项变更；IPC(主分类):G11C7/00；专利申请号:2019100876259；变更事项:申请人；变更前:合肥格易集成电路有限公司；变更后:合肥格易集成电路有限公司；变更事项:地址；变更前:230601 安徽省合肥市经济技术开发区清华路368号；变更后:230601 安徽省合肥市经济技术开发区清华路368号；变更事项:申请人；变更前:北京兆易创新科技股份有限公司；变更后:兆易创新科技集团股份有限公司
2020-08-28

实质审查的生效

状态信息

实质审查的生效；IPC(主分类):G11C7/00；专利申请号:2019100876259；申请日:20190129
2020-08-04

公布

状态信息

公布

摘要

本发明提供了一种读取数据的电路、非易失存储器以及读取电路的方法。所述电路应用于非易失存储器，所述非易失存储器包括存储单元，所述电路包括：灵敏放大器、锁存器、锁存器管理模块、逻辑电路、以及数据输出模块，所述灵敏放大器的个数和所述锁存器的个数分别是所述数据输出模块输出的数据个数的整偶数倍，所述逻辑电路与所述存储单元的位线和所述灵敏放大器分别连接，所述灵敏放大器与所述逻辑电路和所述锁存器分别连接，所述锁存器与所述灵敏放大器和所述锁存器管理模块分别连接，所述锁存器管理模块与所述锁存器和所述数据输出模块分别连接，所述数据输出模块与所述锁存器管理模块连接。

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