一种基于CPU+CPLD实现FPGA程序远程升级加载的方法

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专利状态

一种基于CPU+CPLD实现FPGA程序远程升级加载的方法

有效

专利申请进度

申请

2019-05-17

申请公布

2019-09-03

授权

2023-05-26

预估到期

2039-05-17

专利基础信息

申请号	CN201910411158.0	申请日	2019-05-17
申请公布号	CN110196726A	申请公布日	2019-09-03
授权公布号	CN110196726B	授权公告日	2023-05-26
分类号	G06F8/65
分类	计算；推算；计数;
申请人名称	江西山水光电科技股份有限公司
申请人地址	江西省九江市濂溪区生态工业城安平路1010号

专利法律状态

2023-05-26

授权

状态信息

授权
2019-09-03

公布

状态信息

公布

摘要

一种基于CPU+CPLD实现FPGA程序远程升级加载的方法，通过CPU控制代码更新，当FPGA加载失败后，CPU还能重新启动代码更新流程，实现第2次重复加载操作，电路简单，可靠，不升级时上电加载速度快,且不占用CPU资源。该方法解决了一般FPGA的在线升级加载方式使用PS模式或者GPIO模拟JTAG模式，需要占用CPU的资源，且加载速度慢，导致很多设备开机耗时久等缺点。

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