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专利状态
一种X型链路结构的多并发RAM数据传输方法及结构
有效
专利申请进度
申请
2020-04-27
申请公布
2020-08-28
授权
2024-02-13
预估到期
2040-04-27
专利基础信息
申请号 CN202010345579.0 申请日 2020-04-27
申请公布号 CN111597138A 申请公布日 2020-08-28
授权公布号 CN111597138B 授权公告日 2024-02-13
分类号 G06F15/167;G06F15/173;CN101477512A,2009.07.08;CN105468568A,2016.04.06;CN107852379A,2018.03.27;CN110908929A,2020.03.24;CN1622516A,2005.06.01;US2017220499A1,2017.08.03王一拙;左琦;计卫星;王小军;石峰;.访存敏感的增量式MPSoC应用映射.计算机研究与发展.2015,(05),206-217.;OrestisLiolis.Quantum-dot
分类 计算;推算;计数;
申请人名称 科大讯飞股份有限公司
申请人地址 安徽省合肥市高新开发区望江西路666号
专利法律状态
  • 2024-02-13
    授权
    状态信息
    授权
  • 2020-09-22
    实质审查的生效
    状态信息
    实质审查的生效;IPC(主分类):G06F15/167;申请日:20200427
  • 2020-08-28
    公布
    状态信息
    公布
摘要
本发明提供一种X型链路结构的多并发RAM数据传输方法及结构,该方法包括:通过多个物理独立的子RAM映射成一个共享存储RAM;获取基于共享存储的片上多核处理器的每个核所对应的接口;在所述接口与所述子RAM之间设置多级链路传输结构,每一级所述链路传输结构设置有多个X型结构路由器;每个所述接口通过所述X型结构路由器与每个所述子RAM之间形成固定的传输路径,以对数据流进行发送或响应。本发明解决现有多并发RAM电路面积过大且仲裁电路过于复杂,造成布局布线困难的问题,无需路由FIFO和仲裁电路,因而硬件资源开销小,只有少量扇入扇出的x型路由器,简化布局布线并有效提升电路主频。