一种降低ESD器件对高速信号影响的电路及方法

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专利状态

一种降低ESD器件对高速信号影响的电路及方法

有效

专利申请进度

申请

2020-06-22

申请公布

2020-10-02

授权

2023-02-14

预估到期

2040-06-22

专利基础信息

申请号	CN202010571280.7	申请日	2020-06-22
申请公布号	CN111740400A	申请公布日	2020-10-02
授权公布号	CN111740400B	授权公告日	2023-02-14
分类号	H02H9/04;H02H9/08
分类	发电、变电或配电;
申请人名称	广东九联科技股份有限公司
申请人地址	广东省惠州市惠澳大道惠南高新科技产业园惠泰路5号

专利法律状态

2023-02-14

授权

状态信息

授权
2020-10-02

公布

状态信息

公布

摘要

本发明一种降低ESD器件对高速信号影响的电路，包括一个或多个高速信号SIGNALg，一个或多个低速信号SIGNALd，使一个或多个高速信号SIGNALg、以及一个或多个低速信号SIGNALd通过的信号接口电路。信号接口电路，包括：一个或多个高速信号接口端，一个或多个低速信号接口端，电源端VCC，接地端GND，一个或多个ESD器件De，寄生电容Cj，为ESD器件De所产生的寄生电容，一个或多个改良电路Cg，一个改良电路Cg对应一个高速信号SIGNALg而设置。改良电路Cg为以PCB走线或者以分立元件或者以集成在器件内部达到方式中的任一种。本发明能够在为高速信号提供静电防护特性的同时，降低静电防护器件寄生电容对高速信号的影响，提升高速信号的质量，提高线路支持的信号速率，提高产品可靠性。

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