一种频差估计方法、FPGA及存储介质

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专利状态

一种频差估计方法、FPGA及存储介质

有效

专利申请进度

申请

2021-06-22

申请公布

2021-11-05

授权

2024-02-06

预估到期

2041-06-22

专利基础信息

申请号	CN202110689514.2	申请日	2021-06-22
申请公布号	CN113612706A	申请公布日	2021-11-05
授权公布号	CN113612706B	授权公告日	2024-02-06
分类号	H04L25/02;H04L27/00;H04L27/26
分类	电通信技术;
申请人名称	武汉高德红外股份有限公司
申请人地址	湖北省武汉市东湖开发区黄龙山南路6号

专利法律状态

2024-02-06

授权

状态信息

授权
2021-11-23

实质审查的生效

状态信息

实质审查的生效；IPC(主分类):H04L25/02；申请日:20210622
2021-11-05

公布

状态信息

公布

摘要

本发明涉及无线通信技术领域，为一种频差估计方法、FPGA及存储介质，包括以下步骤：S1，选取预设点数量的PN序列作为同步头；S2，将整个频差估计分成多次对所述同步推进行递进估计，且后一次比前一次的精确度更高；S3，将最后一次的频差估计结果作为最终的频差估计值，为后续的码片数据提供频差校正参数。该方案在大量节省帧同步头开销的条件下，采用递进式的CFO估计手段，达到低信噪比下的优异性能，还能保证在超低信噪比snr下的频差估计性能，且只需一次频差校正计算，具备很强的实用价值。另一方面，整套算法FPGA实现中，主值的求取，差异的求取，都可以利用FPGA语言的自动wrap来实现，非常巧妙。

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