高速加解密USB桥接芯片以及芯片高速加解密方法

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专利状态

高速加解密USB桥接芯片以及芯片高速加解密方法

有效

专利申请进度

申请

2009-03-06

申请公布

2009-08-19

授权

2011-08-03

预估到期

2029-03-06

专利基础信息

申请号	CN200910025475.5	申请日	2009-03-06
申请公布号	CN101510245A	申请公布日	2009-08-19
授权公布号	CN101510245B	授权公告日	2011-08-03
分类号	G06F21/24;G06F12/14
分类	计算；推算；计数;
申请人名称	同方股份有限公司
申请人地址	北京市海淀区王庄路1号清华同方科技大厦A座30层

专利法律状态

2013-02-13

专利实施许可合同备案的生效、变更及注销

状态信息

专利实施许可合同备案的生效；IPC(主分类):G06F21/24；合同备案号:2012110000187；让与人:同方股份有限公司；受让人:同方计算机有限公司；发明名称:高速加解密USB桥接芯片以及芯片高速加解密方法；申请日:20090306；申请公布日:20090819；授权公告日:20110803；许可种类:独占许可；备案日期:20121221
2011-08-03

授权

状态信息

授权
2011-03-16

专利申请权、专利权的转移

状态信息

专利申请权的转移IPC(主分类):G06F 21/24变更事项:申请人变更前:苏州国芯科技有限公司变更后:同方股份有限公司变更事项:地址变更前:215011 江苏省苏州市高新区竹园路209号苏州创业园C2031室变更后:100083 北京市海淀区王庄路1号清华同方科技大厦A座30层登记生效日:20110126
2009-10-14

实质审查的生效

状态信息

实质审查的生效
2009-08-19

公布

状态信息

公布

摘要

一种高速加解密USB桥接芯片以及高速加解密方法，芯片包括：第一USB接口(103)、第二USB接口(104)、加密算法模块(102)、内部存储器(107)、CPU(105)、数据缓存器、数据缓存控制器(101)。本发明作为加解密桥接装置应用于主机(20)与移动存储设备(30)之间的连接，在芯片中利用数据缓存控制器中第二控制位和第三控制位的交替使能来切换第一USB接口、加密算法模块和第二USB接口的逻辑地址，与第一数据缓存区、第二数据缓存区和第三数据缓存区的物理地址之间的映射关系，使第一数据缓存区、第二数据缓存区和第三数据缓存区轮流跟随第一USB接口、加密算法模块和第二USB接口并行工作，在主机与移动存储设备之间传递数据批次，从而提高了数据的加解密速度。

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