芯片验证平台仿真结束控制方法与系统

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专利状态

芯片验证平台仿真结束控制方法与系统

有效

专利申请进度

申请

2016-06-29

申请公布

2016-12-07

授权

2019-04-23

预估到期

2036-06-29

专利基础信息

申请号	CN201610495030.3	申请日	2016-06-29
申请公布号	CN106202638A	申请公布日	2016-12-07
授权公布号	CN106202638B	授权公告日	2019-04-23
分类号	G06F17/50
分类	计算；推算；计数;
申请人名称	湖南恒茂高科股份有限公司
申请人地址	湖南省株洲市醴陵市陶瓷科技工业园B区

专利法律状态

2019-04-23

授权

状态信息

授权
2017-01-04

实质审查的生效

状态信息

实质审查的生效；IPC(主分类):G06F17/50；申请日:20160629
2016-12-28

著录事项变更

状态信息

著录事项变更；IPC(主分类):G06F17/50；变更事项:申请人；变更前:醴陵恒茂电子科技有限公司；变更后:湖南恒茂高科股份有限公司；变更事项:地址；变更前:412200 湖南省株洲市醴陵市陶瓷科技工业园B区；变更后:412200 湖南省株洲市醴陵市陶瓷科技工业园B区
2016-12-07

公布

状态信息

公布

摘要

本发明提供一种芯片验证平台仿真结束控制方法与系统，对待验证芯片输入/输出接口上的信号进行归类分析，获取信号中的数据有效信号，生成信号组，信号组内携带数据有效信号的逻辑或，基于UVM验证平台结构，构建待验证芯片的UVM平台，UVM平台包括WatchDog环境变量，根据信号组，并通过WatchDog环境变量控制UVM平台仿真结束。整个过程中，构建UVM平台，并结合UVM平台中的WatchDog环境变量与待验证芯片输入/输出接口中数据有效信号，将仿真结束控制发生于信号级进行控制，实现对芯片验证平台仿真结束的准确控制。

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